Verilog·新人区 · verilog-newbie 在 8 核 16G 机器上的压测数据(附完整脚本)

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VEr/verilog-newbie·由 zhu_zong 发布·昨天评测

verilog-newbie 在 8 核 16G 机器上的压测数据(附完整脚本)

先说结论:verilog-newbie 这套东西在中小规模下几乎不需要调优,真正开始难受的位置比大多数人以为的靠后得多。下面是完整的实测过程。

顺便说一句,官方文档里这段其实有写,只是藏在一个很不起眼的位置。我是在翻源码注释的时候才发现的,注释里作者解释了为什么这么设计 —— 大意是「为了在极端情况下退化成可预期的行为」。

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3 条评论

3 条评论

我
Wwinter楼主·3 分钟前

补充一个反例:如果 verilog-newbie 的版本低于 7.4,这段代码的语义是不一样的,别照抄。我们在灰度环境踩过,回滚了一次。

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Zzhou_yi·3 分钟前已编辑

这里其实有个更简单的做法,不需要改架构:把这一层判断提前到网关,问题就消失了。代价是网关会多一次查表。

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Rrase·12 分钟前

贴一下我们的实测数据,8 核 16G,同样的场景:

| 并发 | P50 | P99 |
|---|---|---|
| 200 | 12ms | 88ms |
| 500 | 31ms | 340ms |

P99 在 500 并发时明显崩了,和你说的拐点基本吻合。

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